描述

IC693CPU374-GP

系統(tǒng)設計思路如下：ISP1581和MCU的連接采用斷開總線模式，數(shù)據(jù)傳輸使用MDMA模式，ISP1581的16位DMA總線與FIFO的輸出端相連，A/D模塊的16位數(shù)據(jù)輸出總線與FIFO的輸入端相連。FIFO的寫信號由定時芯片8254根據(jù)A/D采樣頻率產(chǎn)生，F(xiàn)IFO的讀信號直接由ISP1581的DIOR給出(MDMA模式下)，MDMA開始傳輸信號也由8254產(chǎn)生，連接到MCU的一個中斷引腳，用于啟動MDMA。ISP1581和8254的片選信號以及8254的地址、數(shù)據(jù)、控制等信號均在EPLD內(nèi)產(chǎn)生。通過8254和EPLD的設置，可以保證FIFO讀和MDMA寫時序的配合。在本系統(tǒng)中，c8051f02x需要大量訪問ISP1581的內(nèi)部寄存器，因為c8051f系列采用數(shù)據(jù)空間和I/O空間統(tǒng)一尋址方式，必須采用full memory模式，即將ISP1581作為一個普通外設映射到c8051f02x外部存儲空間的I/O空間。綜上，最后的接口電路見圖2。圖中mode0、model、bus_conf等信號需要外接上拉下拉電阻。

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